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经典三路(三条不同的三路)介绍

文章来源:admin 更新时间:2019/08/01

在电路图中,当电路图中的传统计数器的数字信号为奇数时,即使输入是对称信号,输出也不具有50%的占空比输出。原因是内部的。触发均匀上升沿(或下降沿)触发。
在该示例中,触发器KD1和D2分别由不同的时钟边沿激活。通过组合D1,D2和D4,可以获得50%运算速率的除法输出。
当与D3组合时,可以形成具有对称输出的三路电路。
电路3
如图所示,对称输出=三路电路。
如果使用传统计数器将数字脉冲除以奇数,即使输入是对称信号,输出也不会除以占空比的50%。原因是在上升(或下降)边缘拍摄,因为内部触发是均匀的。
要解决这个问题,请使用JK触发器,在不同的时钟边沿激活J和K,如(a)所示。
该电路内部由两个JK触发器和一个RS触发器组成。CLH推出了等效的J-end和CLL,推出了等效的K-side。其他功能与JK触发器相同。
如图(b)所示,将(a)与传统的D触发器相结合,在时钟端子上增加一个反相器,形成一个3路电路,用于对称输出。
图(C)是实用电路。
该图使用74LS113下降触发器,因此省略了它与74LS109时钟引脚之间的反相器。
电路74LS109和74LS113的电路构成具有与(a)相同功能的电路。
74LS113的剩余-4与图(b)中的触发器D相同。